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3D Encoder SOC design verilog

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최초등록일 2018.10.25 최종젿작일 2010.09
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3D Encoder SOC design verilog
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    목차

    Ⅰ. 개 요
    1. 프로젝트를 하게된 동기
    2. 프로젝트의 주요내용 설명

    II. 관련 연구
    II-1. 3D 영상압축 기본 설명
    II-2. 시간적 중복 영상압축
    1. Motion Estimation(ME)
    2. Macro block 당 1개/16개의 벡터
    3. Motion Estimation 탐색 방법
    4. Searching Area
    II-3. 인접 영상간의 영상압축
    1. Disparity Estimation(DE)
    2. Disparity 정보 산출과정
    II-4. 기존의 MB 선택 방법
    II-5. 제안하는 MB 선택 방법

    III. ME/DE 칩 설계
    1. 설계 요구사항
    2. 핵심 구조기능 상세 설계

    IV. 3DTV(Multi-view)의 핵심 인코더의 구현
    IV-1. SOC design을 위한 설계 흐름
    IV-2. 알고리즘 검증
    1.C++ 검증 (using Visual studio)

    IV-3. RTL description 작성
    1.Verilog HDL

    IV-6. Placement & Routing (using Astro)
    1. Verilog to Cell
    2. FloorPlan
    3. Power ring 연결
    4. Placement
    5. CTS (Clock-tree-synthesis)
    6. Routing
    7. DRC_LVS
    IV-6. 최종검증 (using VCS)

    V. 결론 및 향후 연구

    참고문헌

    본내용

    요 약
    3D 영상을 압축하기 위해서는 시간적 중복을 이용한 motion estimation(ME)과 인접 영상간의 중복을 이용한 disparity estimation(DE)방법이 필요하다. ME왿 DE는 비교하는 대상이 다를 뿐 압축 알고리즘은 동일하다. 압축 알고리즘 중 H.264 / MPEG-4 AVC의 variable block size ME(VBSME)는 이전의 fixed block size ME(FBSME)보다 더 높은 압축 효율을 보여주었다. 하지만 기존의 VBSME의 macro block(MB)선택 방법은 16by16 MB에서 4by4 MB로 선택하기 때문에 block size선택 속도가 느리다는 단점이 있다. 이 문제를 해결하기 위해서는 모든 경우의 MB size를 동시에 계산하여 선택해줘야 한다. 이 방법을 이용하여 VBSME왿 VBSDE를 Pipelined Hardware Architecture기반의 SOC로 설계한다.
    Key Words : 3D encoder, Motion estimation, Disparity estimation, variable block size, Pipelined Architecture

    Ⅰ. 개 요
    1. 프로젝트를 하게된 동기 기존에 멀티미디어를 다루는데 있어서 학부수준에서 다뤄 왔던건 소프트웨어 수준에 치중해 있었다. 그러던 중 Hardware language를 접하게 되었고, 멀티미디어를 구현하는데 있어 하드웨어로 구현을 시도해보면 보다 나은 성능을 추구 할 수 있을 거라 생각하였다. 기존의 소프트웨어에서의 한계가 있기 때문에 이러한 한계를 하드웨어에서 극복할 수 있기 때문이다 .또한 멀티미디어에 대한 하드웨어적인 접근 마인드를 증진시킬 수 있는 계기가 되었다. 2. 프로젝트의 주요내용 설명 3D 영상은 두 대 이상의 카메라에서 들어오게 되는 영상을 기반으로 각 영상에 대해 그 영상사이의 유사점을 이용하여 최소영상을 보내는 것을 기본적인 원리로 사용한다. 3D 영상을 압축하기 위해서는 시간적 중복을 이용한 motion estimation (ME)과 인접 영상간의 중복을 이용한 disparity estimation(DE)방법이 사용된다.

    참고자료

    · 김승환, 호요성, “H.264/AVC 표준의 소스 코드 분석”, 두양사, pp. 95-100, 2007
    · E.G. Richardson, "gH.264 and MPEG-4 Video Compression,"h John Wiley & Sons, pp.170-187, Sept.2003.
    · 박기현, “코덱의 세계로의 초대”, 2006
    · SAMIR PALNITKAR , “Verilog HDL", 2005.
    · Rafael C. Gonzalez, Richard E. Woods, "Digital Image Processing", Addison Wesley, pp 416 ~ 429, 1992
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