"3D Simulation"의 검색결과 입니다.

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"3D Simulation" 검색결과 681-700 / 1,498건

서강대학껓 디지털논리회로실험 7주차결과

Machine을 구분하고 각각의 특성을 이해한다.● 비동기 Counter의 동작을 분석한다.3. 실험 내용 및 결과분석① Flip-Flop Conversion● D Flip ... equence detecting이 이루어진다.▲ Simulation result of 101, 110, 011 detector using D Flip-flops (Moore type ... 다110, 011 detector using D Flip-flops (Mealy type)▲ Simulation result of 101, 110, 011 detector

리포트 | 8페이짿� | 2,000원 | 등록일 2014.01.02

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CAD 작업

Mapping1 3D Mapping2 Textile DESIGN 3D Simulation10 년 뒤 자기 모습 연필 스프레이 크레파스 툴로 그리고 색칠 문자 툴로 ( 고정 / 수정 ... 소재로 생각하고 만들어보았습니다 .31. 3D SIMULATION 보호팬 결선잡기 입혀보기 배경 – 그라데이션 효과 3D 를 통해 옷을 입혀보았습니다{nameOfApplication} ... 가지 ( 실짜기 포함 ) 전통문양 1 전통문양 전통문양 2 꽃문양 1 꽃문양 2 후가공만들기 , 후가공 적용 페이즐리문양 방모효과 – 긁기 색분해 다색전개 스캔문양 수정 3D

리포트 | 53페이짿� | 3,000원 | 등록일 2015.11.24

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실험01 MOSFET 특성(예비)

를 꾸미고, 입력과 출력 파형을 관찰하고 전압이득이 얼마인지 계산해 보라.3.바이어스 저항R _{D}가 1.78kΩ,2.0kΩ,4.0kΩ로 변경하였을 때, 부하선에 따른 동작점 ... ][R _{D} =1.33K][R _{D} =1.78K][R _{D} =2.0K][R _{D} =4.0K][Simulation 결과 2]5. 기타사항1학기때 공부한 BJT와 비슷하지 ... -MOSFET]게이트 전극의 +전압에 의해 게이트 바로 밑의 D-S사이에 N형의 반전층이 형성된다. D-S사이에는 pn접합 부분이 없어지고 n-n-n구조가 되므로 전류I _{D}가 D-S

리포트 | 4페이짿� | 1,000원 | 등록일 2014.12.11

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기계진동 설계과제 : 진동흡수장치 및 현가장치 설계

기계진동 설계 Project3기계진동 설계 Project기계진동 흡수장치 : 현가장치설계1. 서론2. 승용차 시뮬레이션, Simulation #13. 승용차 시뮬레이션 ... , Simulation #2~64. 5명이 탑승하였을 때 시뮬레이션,Simulation #7~155. 결론6. Reference7. 부록 A - Simulation 매개변수 정리표8. 부록 ... B - Simulation Graph1. 서론자동차는 주행 시 불규칙한 노면 상태 등으로 인하여 외부로부터 진동을 받게 된다. 이러한 진동 등은 탑승자에게 시각, 청각, 촉각 등

리포트 | 40페이짿� | 4,000원 | 등록일 2015.03.17

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[보고서1등] DC Motor 구동 및 DAQ (결과) [A+] 아주대 기계공학응용실험

을 이용하고 Step신호 3V, -3V 입력 값에 대하여 실험 이론 Simulation code와 같이 시뮬레이션을 실행하고 실험 데이터의 회전각과 시뮬레이션 결과를 비교하여 그래프 ... 장 치 및 방 법/ 5결 과 및 토 의/ 25결 론/ 10합 계/ 60비 고아주대학껓 기계공학부- 목 차 -1. 실험 목적2. 실험 이론3. 실험 장치4. 실험 방법5. 실험 결과 ... 를 다음과 같이 모델링 한다.J _{m} {ddot{theta }} _{m} +B _{m} {dot{theta }} _{m} =K _{t} V _{a}3. 실험 장치① DAQ 보드

리포트 | 13페이짿� | 3,900원 | 등록일 2019.09.05

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사업계획서 작성(수립) 지침

준 (’18 년 실적 ) Gap 당해 년도 분기별 목표 평가방법 산출방식 1Q 2Q 3Q 4Q D 75 미만 C 75 B 85 A 95 S 105 이상 최대 ’19 년도 비고 ... 수립 인원계획 투자계획 예산 ( 비용 ) 계획 경영 Simulation 사업계획 W/Shop 최종 수정 , 보완 , 조정 최고 경영진 보고 상품개발 예비 발의 9/17 일 ~9/20 ... 일 9 월 10 월 11 월 12 월 1W 2W 3W 4W 1W 2W 3W 4W 1W 2W 3W 4W 1W 2W 3W 4W 9/14 일 배포 상품개발 검토 9/21 일 ~10

서식 | 26페이짿� | 3,000원 | 등록일 2019.08.29

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실험2 제07주 Lab05 Pre Mux & DMux & BCD

Functional Simulation & Timing Simulation과 일치하는지 확인한다3) Procedure of Lab 3① BCD to Excess-3 code converter ... 결과인 Functional Simulation & Timing Simulation과 일치하는지 확인한다3. Predata of this Labs1) Lab 1 of 2-bit 2 ... -bit 4:1 Mux3) Lab 3 of BCD to Excess-3 Code Convertor4. Summarize5. Reference1. Introduction1) Purpose

리포트 | 8페이짿� | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17

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Final Project 전자전기컴퓨터설계 실험 3 (2014.05.30)

회로 및 본 교과목인 전자전기컴퓨터설계실험3에서 습득한 지식을 바탕으로 전기회로 및 전자회로의 해석, 설계, 제작, 측정, 테스트 등 일련의 과정을 경험함으로써 설계능력을 함양 ... , Duty cycle과 자유 구동 주파수는 2개의 외부 저항과 1개의 커패시터에 의해 제어된다.1.Gnd (접지단자) 2.Trigger 3.Output 4.Reset 5.Control ... #)173569139278554110922184435레(D)183773147294587117523494699레#(D#)203978156311622124524894978미(E

리포트 | 11페이짿� | 1,500원 | 등록일 2014.07.01 | 수정일 2014.07.03

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[VerilogHDL]lpm_rom 하위모듈을 이용한 rom설계와 ram설계

를 설계 할 수 있다.? 어드레스 입력이 4비트, 데이터 출력이 8비트인ROM 을 설계한다.lpm_romaddressqinclock십진수Input(A[3..0])Output(D[7..0 ... ])HEXA3A2A1A0D7D6D5D4D3D2D1D0000000000 ... 코드 작성(구조적표현)module rom48(A, clk, D);input [3:0] A;input clk;output [7:0] D;lpm_rom romdata (.address

리포트 | 4페이짿� | 1,000원 | 등록일 2013.05.25

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메트랩을 이용한 업다운 카운터 밀리모델

하여 Simulation 결과를 확인한다.Clock-mode Sequential Circuit의 일반 모델로 결과를 확인한다.Ⅱ. 과제의 필요성동기식 카운터의 장점은 n개로 구성 ... Simulink Model 모델링을 사용하여설계의 결과값을 도출한다.1) 문제 정의 및 설계 기능 묘사2) 상태도3) 상태표4) 상태할당5) 상태 천이표6) 출력함수 제작7) 논리 표8 ... ’이 된다.1) 상태도2) 상태표Present StateNextStateOutput(Z)X=0X=1X=0X=1L0L15L100L1L0L200L2L1L300L3L2L400L4L3L

리포트 | 10페이짿� | 1,000원 | 등록일 2016.11.25

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실험2 제10주 Lab08 Pre Counter & 7Segment & Piezo

장비를 구동시켜본 후, Prelab 결과인 Functional Simulation & Timing Simulation과 일치하는지 확인한다.3. Predata of this ... Clock을 분주하면 되는데 CTC Mode 중 ICR(Input Capture Register)3 레지스터가 TOP으로 정확히 50% 유지되며 출력주파수는가 되고 3옥타브의 각 ... 결과인 Functional Simulation & Timing Simulation과 일치하는지 확인한다.2) Procedure of Lab 2① 7 Segment With

리포트 | 8페이짿� | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.14

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전전컴실험Ⅱ 06반 제03주 Lab#02 [『HBE-ComboⅡ-SE』, 『ISE』] 예비 보고서

를 만든회로를 완성하고 전원을 키기 전에 한번 더 확인한다.3. PreLab - Expected/Simulation Results of this Lab (실험 결과 예상 ... 63’, b=”P67”, f=’P16’으로 지정해 주었다.다. PreLab 3. (XOR GATE)(1) Expected/Simulation Data(2) Description ... ‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 3가. PreLab 1.‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 3나. PreLab 2.‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 3다. PreLab 3

리포트 | 14페이짿� | 1,000원 | 등록일 2013.09.09 | 수정일 2013.09.15

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[건축환경계획] Ecotect를 활용한 부하계산

한 이미지 및 3D 모델링 엔지니어를 위한 다양한 데이터 기타프로그램과의 연계주 요 기 능 1. Weather Solar Tool ( 기후분석 ) 2. Solar Analysis ( 일사 ... E COTECT- Ecotect ? - 특 징 - 주요기능 - Simulation - 부 하 ? L oad - 부하계산법 E cotect C ontentsL oad부 ... 분석 ) 3. Shadows Reflections ( 음영 분석 ) 4. Shading Design ( 차양 설계 분석 ) 5. Right-to-Light Analysis

리포트 | 30페이짿� | 2,500원 | 등록일 2014.03.31 | 수정일 2014.06.19

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전전컴실험Ⅱ 06반 제02주 Lab#01 TTL gates Lab on Breadboard-Pre

기 전에 한번 더 확인한다.3. PreLab - Expected/Simulation Results of this Lab (실험 결과 예상)가. PreLab 1. ... < t < t1)일 때 x=1 & y=1이 성립해 C=1이 됨을 확인할 수 있다.다. PreLab 3. - Simulation Results of Lab 3.(1) Expected ... /Simulation Data of 두 개의 반가산기로 구성된 전가산기(심화) xyzCLED(D1)FLED (D1)0000X0X0010X1점등 됨0100X1점등 됨0111점등 됨0X

리포트 | 9페이짿� | 1,000원 | 등록일 2013.09.09 | 수정일 2014.03.17

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전전컴설계실험2-11주차 예비

mode set : 데이터를 read하거나 write할 경우에 커서의 위치를 증가시킬 것인가(I/D=1) 감소 시킬 것인가(I/D=0)를 결정하며, 또 이때 화면을 시프트 할 것인지 ... (S=1) 아닌지(S=0)를 결정한다.-Display ON/OFF control : 화면 표시를 ON/OFF 하거나(D), 커서를 ON/OFF하거나(C), 커서를 깜박이게 할 것 ... 을 한다.-Data Reading from CG or DDRAM : CG-RAM 또는 DDRAM에 데이터를 읽는 동작을 한다.3)Text LCD 제어 순서-전원을 투입 한다.

리포트 | 15페이짿� | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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전자회로실험 예비 - 10. MOSFET 공통 소스 증폭기 (CS)

변하는 것을 의미 한다.다. 예비실험1) 에서 Vin에 0V부터 5V까지 DC sweep을 주어 Vout의 출력 파형을 Pspice로 Simulation 하시오.(R _{D} =1k ... V의 신호가 입력전압으로 가해진다면 대략 9~3V의 출력전압을 얻을 수 있을 것이다.2) 에서 Vin에 소신호를 인가한 후 Vout의 출력 파형을 Pspice로 Simulation ... 하시오.(Vin = 20mV, V _{GS`} = 3V, R _{D} = 1kΩ, V _{DD} = 10V)< 입력 소신호를 인가해준 회로도 >< 위의 40mV(p-to-p) 소

리포트 | 10페이짿� | 1,000원 | 등록일 2015.04.20

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전전컴설계씄험2-7주차예비

논리 회로의 특성을 이해하고 실제 실험을 하기 전에 Xilinx 설계를 통해 이번 실험에 대한 모의 Simulation을 해본다. 응용과제인 BCD to Excess 3 Code ... 입력A, B, C, D : 버튼스위치1, 2, 3, 4입력S : BUS Switch 1, 2출력Q : LED 1-실험 이론4x1 MUX : Y= S1’S0’I0+S1’S0I1+S1 ... 을 수행하여 bit 파일을 생성한다.6. Simulation을 통해 실험 예상값을 확인한다..7. BCD to Excess-3 Code Convertor의 Test Bench 파일

리포트 | 15페이짿� | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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청색증 아동 - 시뮬레이션 시나리오

1. 청색증이 나타나는 신생아 간호주제청색증이 나타나는 신생아 간호상황 소개제태기간 38+3주에 남아가 정상 신생아실에 입실하였다. 신생아실에 왔을 때 입주위에 청색증이 있 ... 고 그르렁거리는 호흡음이 들린다.환자 개요1. 이름 : ○○○ 아기2. 성별 : 남3. 제태기간 : 38+3주4. 출생순위 : 첫째5. 체중 : 3kg6. 키 : 49cm7. APGAR ... : 1분 8점, 5분 9점1. 30세, 주부, O형2. 임신횟수 1회, 분만횟수 1회3. 자연분만4. cord coiling (-)5. PROM(-)6. Amniotic

리포트 | 4페이짿� | 1,000원 | 등록일 2017.05.17 | 수정일 2017.05.19

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아주대 전자회로실험 설계 결과보고서 2. C측정회로

do exist;3. to be honest and realistic in stating claims or estimates based on available data;4. to ... CMOS 능동부하 증폭단의 특성을 측정하는 실험까지 추가로 실시하여 총 3가지의 실험을 진행하였다.따라서 이번실험에서 공통소스단의 특성을 분석하고 또한 공통소스단을 이용한 CMOS ... 의 특성을 잘 알아 볼 수 있는 실험회로를 찾았고 그 결과 Degeneration을 사용한 회로를 구성하고자 계획하고 직접 실험하였다.3. 실험 이론실험 이론은 다음과 같다. 우리

리포트 | 17페이짿� | 2,000원 | 등록일 2015.10.06 | 수정일 2015.10.31

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원자력 R&D

1. 원자력 R&D11-1. 원자력 R&D 추진11) 추진개요12) 원자력기술개발사업33) 방사선기술개발사업71. 원자력 R&D1-1. 원자력 R&D 추진1) 추진개요원자력연구 ... 개발, 방사선기술 고도화를 통한 신물질?신기술 확보, 원자력 혁신연구 강화 및 고급인력양성을 위하여 총 3,105 억원을 지원하였다(1) 추진 경과 및 체계현재 미래창조과학부 ... 위해 '예측평가, 사고예방, 사고대응' 등 3개 소분류를 신설하여 연구과 제간 연계성을 강화하여 최고 수준의 원자력 안전기술 역량 확보를 추진하였다.'방사선기술 분야'는 방사선융합

리포트 | 14페이짿� | 2,000원 | 등록일 2017.12.31

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